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嵌入式系統(tǒng)調試方法-預覽頁

2026-06-12 07:27 上一頁面

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【正文】主機的調試器可以通過 CPU外部特設的通信接口來訪問系統(tǒng)資源并執(zhí)行指令。 ?基于 C語言可移植性原理，有許多程序模塊完全可以在主機上開發(fā)和調試，這些模塊應該用標準 C語言編寫，與硬件無關，如各種算法程序。 ?字節(jié)排序問題主要是大小端問題。 ?基于主機的調試方法的另一個例子是 ATI公司的 MNT，Nucleus Plus是 ATI公司的一個商用嵌入式實時多任務操作系統(tǒng) ，支持眾多的處理器。調試器的兩部分（主機部分和目標機部分）通過串口 /并口 /以太網(wǎng)等端口相互通信。 ?調試代理以中斷服務程序 ISR的方式提供，中斷源一般設置成高優(yōu)先級中斷，有時與 NMI的中斷優(yōu)先級一樣高，通常來自于串口 /并口 /以太網(wǎng)等設備，由主機控制中斷發(fā)生與否，以保證調試器訪問中斷總能被處理到，否則如果某個應用程序關閉了所有中斷，那么調試器就再也不能恢復對系統(tǒng)的控制了。如下圖所示。第 3講嵌入式系統(tǒng)調試方法 3． 3． 3 ROM仿真器的功能（ 1）縮短調試周期。（ 3）仿真多種接口。 ICE提供自己的 CPU和 MEM，不再依賴目標系統(tǒng)的 CPU和 MEM。完成調試之后，再使用目標板上的 CPU和 MEM實時運行應用程序。這種設計確保 ICE始終保持對系統(tǒng)運行的控制，甚至在目標系統(tǒng)崩潰后也是如此，保護調試代理不受目標系統(tǒng)錯誤的破壞。其插座引腳設計與微處理器的引腳設計相匹配，實現(xiàn)輕松替換，方法是將目標系統(tǒng)上的 CPU拔掉，插上 ICE的仿真頭。第 3講嵌入式系統(tǒng)調試方法 3． 4． 4 優(yōu)缺點優(yōu)點是具有實時跟蹤能力，缺點是價格較高，特別是高速CPU在線仿真器。 ?nwire優(yōu)點：機械連接較簡單，與目標系統(tǒng)上的 CPU一起運行，與 CPU的變化無關，簡化設計工具，低成本、可重用、簡單； ?nwire缺點：大多數(shù)只提供運行控制，特性受限于芯片廠商，非常慢，不支持覆蓋內(nèi)存，不能訪問其它總線。 RESERVED 1 2 BREAKPOINT GND 3 4 DSCLK GND 5 6 RESERVED RESET 7 8 DSI +5V 9 10 DSO GND 11 12 PST3 PST2 13 14 PST1 PST0 15 16 DDATA3 DDATA2 17 18 DDATA1 DDATA0 19 20 GND RESERVED 21 22 RESERVED GND 23 24 CLK_CPU Vcc_CPU 25 26 TEA 第 3講嵌入式系統(tǒng)調試方法 ?BDM同時支持處理器控制和定時跟蹤監(jiān)視方式。注：終止 —— 為執(zhí)行此命令， CPU必須終止運行；周期竊取 —— 命令產(chǎn)生一個總線周期，把它插入到 CPU訪問周期中；并行 —— 命令與 CPU活動并行執(zhí)行。 ?軟件把調試命令和數(shù)據(jù)通過仿真器發(fā)送到目標處理器中，然后接收目標處理器的狀態(tài)信息。現(xiàn)在多數(shù)的高級器件都支持 JTAG協(xié)議，如 DSP、 FPGA器件等。現(xiàn)在， JTAG接口還常用于實現(xiàn) ISP（ InSystem Programmable，在線編程），對 FLASH等器件進行編程。 ?目前大多數(shù)嵌入式處理器廠商在其處理器上集成了 JTAG接口，如 ARM。數(shù)據(jù)流從進入 CPU核心到輸出 CPU核心會形成一個很長的循環(huán) 。 ? 功能強大的 ISS可以仿真處理器的每一個細節(jié) ，包括外設和中斷；簡單的 ISS至少可以仿真 CPU的指令系統(tǒng) 。 ?有的 ISS提供了對指令的執(zhí)行時間的仿真。第 3講嵌入式系統(tǒng)調試方法 3． 7． 1 軟件仿真器的優(yōu)點（ 1）可以使嵌入式系統(tǒng)的軟件和硬件并行開發(fā)；（ 2）可以發(fā)現(xiàn)和定位應用程序的邏輯錯誤，甚至可糾正某些與硬件相關的故障；（ 3）可以評估嵌入式系統(tǒng)產(chǎn)品的設計性能。

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