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微機原理課件-第6章(存儲版)

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【正文】 CPU響應(yīng)中斷： ?當前指令執(zhí)行完。 IPL IPH CSL CSH FLAGL FLAGH SP IPL IPH CSL CSH FLAGL FLAGH SP IP CS FLAG 進入中斷服務(wù)程序時中斷返回后 8088的中斷系統(tǒng) ?與中斷有關(guān)的控制線為： NMI、 INTR、 INTA ? 8088系統(tǒng)的中斷源 ?內(nèi)部中斷 ?除法溢出：類型號 0，商大于目的操作數(shù)所能表達的范圍時產(chǎn)生。 ?溢出、斷點、除法溢出、單步、非屏蔽中斷的類型碼為固定值 ?軟件中斷的類型碼由指令給出 ?可屏蔽中斷的類型碼由 PIC給出 ?CPU響應(yīng) INTR中斷時，會產(chǎn)生兩個中斷響應(yīng)總線周期 (教材圖 622)，要求 PIC在第 2個中斷響應(yīng)總線周期把中斷類型碼放到數(shù)據(jù)總線上，供 CPU讀入。 TF，中斷入口 →CS:IP 單步中斷處理程序 (IF、 TF = 0) 返回 (IF、 TF = 1) 返回 62 作業(yè)： 17 第 2版 :(p275) 17 。 IF=1時 CPU才能響應(yīng)。 ?獲得中斷服務(wù)程序首地址（入口）。 D0 D7 ~ CPU INTR ≥1 并行輸入接口中斷請求寄存器 IRQ0 IRQ1 IRQ2 IRQ3 IRQ4 IRQ5 IRQ6 IRQ7 軟件查詢程序流程：斷點保護中斷源 0的中斷服務(wù)程序中斷源 1的中斷服務(wù)程序中斷源 7的中斷服務(wù)程序中斷返回 IRQ0 IRQ1 IRQ7 Y N N N Y Y 軟件判優(yōu)的硬件支持電路 INTAin CPU INTA INTR 外設(shè) 1 外設(shè) 2 外設(shè)接口 1 菊花鏈邏輯電路外設(shè)接口 2 外設(shè) 3 外設(shè)接口 3 ≥1 菊花鏈邏輯電路菊花鏈邏輯電路 ┇ IREQ IREQ IREQ 中斷確認鏈式判優(yōu)電路原理圖（教材圖 618） INTAin INTAin 中斷確認中斷確認菊花鏈邏輯電路 INTAin IREQ INTR amp。識別中斷源有兩個方法： ?軟件查詢。 IF=1時，執(zhí)行完當前指令后 CPU對它作出響應(yīng)。缺點：程序的執(zhí)行速度限定了傳送的最大速度（約為幾十 KB/秒） — 解決： DMA傳輸四、直接存儲器存取控制方式 32 DMA傳輸 : 外設(shè) 內(nèi)存外設(shè)直接與存儲器進行數(shù)據(jù)交換， CPU不再擔(dān)當數(shù)據(jù)傳輸?shù)闹薪檎撸? 總線由 DMA控制器（ DMAC）進行控制（ CPU要放棄總線控制權(quán)），內(nèi)存 /外設(shè)的地址和讀寫控制信號均由 DMAC提供。取數(shù)據(jù) OUT DATAPORT， AL 。數(shù)據(jù)傳送的過程如下：開始取外設(shè)狀態(tài) 外設(shè)準備就緒否？傳送數(shù)據(jù) 傳送完否？ N Y Y N 結(jié)束 25 查詢輸入方式狀態(tài)端口 :STATUSPORT 數(shù)據(jù)端口 :DATAPORT 查詢輸入程序如下： LOOPIN: IN AL,STATUSPORT 。輸入端口地址： 83FC、 83FD、 83FE、 83FF 編程： MOV DX,83FCH IN AL,DX 15 74LS273 作為輸出接口系統(tǒng) 總線信號 D0 D0 D7 D7 ~ ~ A0 A1 A2 A3 A4 A5 A6 A7 IOW amp。1 第 6章輸入輸出和中斷技術(shù) 2 接口計算機外部設(shè)備種類較多：有機械的、電子的、機電和磁電相結(jié)合的，如鍵盤、磁盤、打印機、顯示器等；外設(shè)的信號種類：數(shù)字量、模擬量、開關(guān)量等 ? 需要解決的問題： ? 傳送速度的匹配； ? 信號形式的匹配； ? 信號電平和驅(qū)動能力； ? 信息格式； ? 時序匹配； 3 如果高速的微處理器與外設(shè)能夠協(xié)調(diào)的工作，就要有一個具有數(shù)據(jù)緩沖和鎖存能力、數(shù)據(jù)格式轉(zhuǎn)換能力、提供外設(shè)狀態(tài)和定時控制能力的連接電路，我們把它叫做輸入輸出接口。所有用于內(nèi)存的指令都可以用于外設(shè)，不需要專門的 I/O指令；缺點：外設(shè)占用了部分地址空間，減少了內(nèi)存可用的地址范圍； 7 二、 I/O端口獨立編址內(nèi)存地址空間和外設(shè)地址空間是相互獨立的；訪問I/O端口有專門的控制信號； CPU采用專用指令對 I/O端口進行訪問（ IN 、 OUT)； I/O獨立編址尋址方式 FFFFH 0000H ? ? ? ? IOW IOR MEMR MEMW I/O CPU 00000H FFFFFH ? ? ? ? MEM 1M 64K 8 +5V 時鐘發(fā)生器 RES 8284 CLK RESET 8088 IO/M RD WR ALE A19～ A16 A15～ A8 AD7～ AD0 DT/R DEN STB OE STB OE STB OE 8282 8282 8282 8286 OE T IO/M RD WR A19 | A16 A15 | A8 A7 | A0 D7 | D0 系統(tǒng)總線信號 8088 +5V MN/MX READY 9 +5V 時鐘發(fā)生器 RES 8284 CLK RESET MN/MX A19～ A8 AD7～ AD0 DT/R DEN CLK

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