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dsp應用技術chappt課件(編輯修改稿)

2026-02-08 09:04 本頁面

　

【文章內容簡介】 SP芯片的 X2/CLKIN引腳，而 X1引腳懸空。 VDD 外部晶振 X2/CLKIN X1 外部時鐘源可以采用頻率穩定的有源晶振，使用方便，驅動能力強，頻率范圍寬，但信號電平是固定的，靈活性較差。第 9章 DSP應用系統設計 (2)使用芯片內部的振蕩器在芯片的 X1和 X2/CLKIN引腳之間接入一個無源晶體 ,用于啟動內部振蕩器。 C1 C2 晶體 X1 X2/CLKIN C1=C2=10pF 第 9章 DSP應用系統設計內部振蕩器產生的時鐘信號質量較差，通常需要精確匹配外圍電路（用于信號匹配的電容、電感、電阻等），更換不同頻率的晶體時外圍電路需做相應的調整。價格較低，但它的驅動能力比較差，一般不能提供多個器件共享，而且頻率范圍也比較小 PLL 鎖相環 PLL具有頻率放大和時鐘信號提純的作用，利用PLL的鎖定特性可以對時鐘頻率進行鎖定 ,為芯片提供高穩定頻率的時鐘信號。鎖相環還可以對外部時鐘頻率進行倍頻，使外部時鐘源的頻率低于 CPU的機器周期，以降低因高速開關時鐘所引起的高頻噪聲。第 9章 DSP應用系統設計 9. 1. 4 復位電路的設計 ’C28x的復位分為軟件復位和硬件復位。軟件復位：是通過執行指令實現芯片的復位。硬件復位：是通過硬件電路實現復位。硬件復位有以下幾種方法 : ? 上電復位 ? 手動復位第 9章 DSP應用系統設計采用 RC延遲電路、專用復位芯片（如 TI公司的TPS3823）設計的復位電路。 R1C110uXRSS1RESET1WDI4GND2MR3VDD5TPS382333XRS160I/OGNDVDDF2812100nFC2去 F2812 的復位引腳第 9章 DSP應用系統設計 9. 1. 5 調試與測試接口現代電路系統越來越強調系統的可調試性，因此調試測試接口的設計也越來越受到重視。對于 F2812系統來說，在開發時就需要設計一個JTAG接口來為芯片下載、調試和測試程序。 1 23 45 67 89 1011 1213 14P1JTAGVCCR110KR210KTRST135TCK136TMS126TDI131TDO127EMU0137EMU1146F2812第 9章 DSP應用系統設計 9. 1. 6 外部擴展存儲器 F2812的片內數據存儲空間比較小（ 18K 16位），在一個需要較多數據或程序存儲空間的系統應用場合，可以外擴一個 SRAM存儲器。 F2812為用戶提供了 5個 XINTF接口，可以擴展大約 1M 16位存儲空間。采用 IS61LV6416 SRAM， IS61LV6416有 16根數據總線和 16根地址總線，最大存儲空間為 64K 16位。使用 F2812的 XINTF區域 2擴展一個 SRAM（IS61LV641610T）的電路原理圖，其地址范圍為：0x08 0000～ 0x08 FFFF。第 9章 DSP應用系統設計 XD[0..15]XA[0..15]XA0XA15 XA15XA14XA12XA13XA11XA10XA9XA8XA7XA6XA5XA4XA3XA2XA1XA0XA2XA3XA4XA1XA6XA7XA8XA9XA10XA11XA12XA13XA14XA5XD0XD1XD2XD3XD4XD5XD6XD7XD8XD9XD10XD11XD12XD13XD14XD15XA15148XA14144XA13141XA12138XA11132XZCS242XD021XD124XD227XD330XD433XD536XD639XD754XWE84XA10130XA9125XA8121XA7118XA6111XA5108XA4103XA385XD865XD968XD1073XD1174XD1296XD1397XD14139XD15147XRD42XA280XA143XA018F2812A151A142A133A124A115CE6D07D18D29D310VCC11GND12D413D514D615D716WE17A1018A919A820A721NC22NC23A624A525A426A327NC28D829D930D1031D1132VCC33GND34D1235D1336D1437D1538LB39UB40OE41A242A1

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