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2026-03-13 01:00本頁面

　　

【正文】 LATTICE CPLD ispLSI系列： 1K、 2K、 3K、 5K、 8K ispLSI1016 、 ispLSI203 ispLSI1032E、 ispLSI3256A MACH系列 ispPAC系列： CPLD/FPGA的編程與配置 JTAG邊界掃描測試在系統可編程（ ISP） CPLD/FPGA的編程方式 60 JTAG邊界掃描測試 ? 20世紀 80年代，聯合測試行動小組（ joint test action group，簡稱 JTAG）起草了邊界掃描測試規范（ boundaryscan testing，簡稱 BST） ? 1990年被批準為 IEEE標準定，簡稱 JTAG標準 ? 邊界掃描測試的優點： ? 方便芯片故障定位，提高測試檢驗效率 ? 通過邊界掃描通道，實現某些特定的功能 61 JTAG邊界掃描測試（續） ? JTAG邊界掃描測試 62 JTAG邊界掃描測試（續） ? 邊界掃描 IO引腳功能引腳描述功能T D I 測試數據輸入( T e s t D a t a I nput )測試指令和編程數據的串行輸入引腳。數據在 T C K 的上升沿移入。T D O 測試數據輸出( T e s t D a t a O ut put )測試指令和編程數據的串行輸出引腳，數據在 T C K 的下降沿移出。如果數據沒有被移出時，該引腳處于高阻態。T M S 測試模式選擇( T e s t M ode S e l e c t )控制信號輸入引腳，負責 T A P 控制器的轉換。 T M S 必須在 T C K 的上升沿到來之前穩定。T C K 測試時鐘輸入( T e s t C l oc k I nput )時鐘輸入到 B S T 電路，一些操作發生在上升沿，而另一些發生在下降沿。T R S T 測試復位輸入( T e s t R e s e t I nput )低電平有效，異步復位邊界掃描電路 ( 在 I E E E 規范中，該引腳可選 ) 。63 ISP功能提高設計和應用的靈活性 ? 減少對器件的觸摸和損傷 ? 不計較器件的封裝形式 ? 允許一般的存儲 ? 樣機制造方便 ? 支持生產和測試流程中的修改 ? 允許現場硬件升級 ? 迅速方便地提升功能未編程前先焊接安裝系統內編程 ISP 在系統現場重編程修改 64 在系統可編程（ ISP）此接口既可作編程下載口，也可作 JTAG接口 65 在系統可編程（ ISP） ? ALTERA 的 ByteBlaster（ MV）下載接口引腳 1 2 3 4 5 6 7 8 9 10PS 模式 D C K GND C O N F _ D O N E V C C n C O N F I G n S T A T U S D A T A 0 GNDJ A T G 模式 T C K GND T D O V C C T MS T D I GND66 CPLD/FPGA的編程方式 ? CPLD的編程模式為 JTAG ? FPGA的 3種常用的下載配置模式 ? JTAG模式 ? PS模式： Passive Serial Mode ? AS模式： Active Serial Mode 67 CPLD/FPGA的編程方式（續） TCK、 TDO、 TMS、 TDI為 CPLD的 JTAG口對 CPLD編程 68 CPLD/FPGA的編程方式（續） 69 70 71 思考題 ? 試比較 CPLD/FPGA的區別 ? 通過查資料了解 ALTERA、 Xilinx公司的主要 CPLD/FPGA芯片系列，試就 2種系列作出比較 ? FPGA的編程配置有哪些模式，試了解各種下載配置的模式的連接圖和意義 72 論壇參考網站 ? ? ? ? ?

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