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vdhl語言出租車計費器課程設計報告-資料下載頁

2026-05-04 22:12本頁面

　　

【正文】 10111111when sel=6 else 01111111when sel=7 else 11111111。 END a。decode3_8模塊時序仿真波形圖：decode3_8模塊選擇數碼管，當sel信號從07變化時，依次選擇18八個數碼管。第3章總體電路圖整體工作情況：、模塊連接：計費模塊的clk、start、stop、pause和speed端連接輸入，money[12..0]和run[12..0]連接轉換模塊的ascore[12..0]與bscore[12..0]；轉換模塊的daclk端連接輸入，age[3..0]至bqian[3..0]連接動態掃描/譯碼/數碼管顯示模塊的a1[3..0]至b4[3..0]；動態掃描/譯碼/數碼管顯示模塊的C[2..0]連接片選輸出SEL[2..0]，DP端連接輸出DP，D[3..0]連接數碼管控制模塊的D[3..0]；片選信號產生模塊的CLK端與輸入信號相連，并連接轉換模塊的DACLK端，A[2..0]連接片選輸出SEL[2..0]，并與動態掃描/譯碼/數碼管顯示模塊的C[2..0]相連；數碼管控制模塊的D[3..0]端與動態掃描/譯碼/數碼管顯示模塊的D[3..0]端相連，Q[6..0]端連接八段數碼管輸出Q[6..0]。、硬件連接：CLK接pin28 輸入為1hz的脈沖；daclk是實驗箱上50Mhz固定晶振START、STOP、PAUSE、SPEED分別連接按鍵開關，用于控制車的啟動、停止、暫停和速度；DP和Q[6..0]分別連接八段碼顯示單元的a到dp；W[7..0]接數據線。、結果分析：該電路的仿真波形圖如下：clk為jifei模塊時鐘信號，daclk為時鐘信號，stop為汽車停止輸入端；start為汽車啟動輸入端；pause為汽車暫停輸入端；speed為汽車速度輸入端。DP表示小數點。該電路的總體管腳分配圖：clk:pin28。daclk:pin153。start:pin4。stop:pin5。pause:pin6。 speed:pin7。dp:pin82。q[6..0]:pin105。pin104。pin101。pin100。 pin85。pin84。pin83。W[7..0]:pin86。pin87。pin88。pin93。pin94。pin95。pin98。pin99。vga[3..0]:pin162。pin161。pin164。pin163。第4章硬件實現通過硬件下載，該電路可以完成硬件實現，芯片管腳定義可以直接用編輯．pin文件。完成管腳定義后選擇器件，編譯后生成．sof、．pof文件。選擇sof文件進行下載。通過對每一模塊的仿真和下載，可以實現各個模塊的邏輯功能，驗證了各個模塊的正確性。在出租車計費系統的5個模塊中，重點在于jifei模塊，x（轉化）模塊，顯示模塊。jifei模塊主要有汽車的啟動、停止、暫停、速度按鍵；轉化模塊主要是把車費和路程轉化為4位十進制；顯示模塊是將車費和路程顯示出來。各模塊完成后，在將它們組合成完整的出租車系統，在設計過程中還需要改進的是控制系統的糾錯功能。出租車計費器系統的設計已全部完成，能按預期的效果進行模擬汽車啟動、停止、暫停等功能，并設計動態掃描電路顯示車費數目，由動態掃描電路來完成。車暫時停止不計費，車費保持不變。若停止則車費清零，等待下一次計費的開始。出租車計費系統的設計中體現了VHDL覆蓋面廣，描述能力強，是一個多層次的硬件描述語言及PLD器件速度快，使用方便，便于修改等特點，本設計在實用方面具有一定的價值。第5章總結兩周的嵌入式系統的課程設計完成了。本次所做的基于CPLD的出租計費器課題很好的結合了VHDL與EDA的課程的內容，使我加深了這兩門課程的理論的的掌握并初步學會了QuartusII軟件及CPLD芯片的使用，使自己的動手能力得到提高。理論知識只有只有經過實踐運用才會有更深刻的理解。拿到任務書后翻閱查找了大量的書籍資料是自己對課題有了一個簡單概括的了解，課題要求能過實現出租車按照行駛里程計費并且能模擬汽車起動、停止、暫停以及速度等狀態，還要將車費和路程顯示出來并精確到小數點后兩位可是說功能較多設計起來自然就會很復雜。自己雖然學習了VHDL以及EDA這兩門課程但自知學到的只是一丁點的皮毛自然是沒有辦法很好的運用所以只能大量的搜集資料以及相關的內容多做、多看、多了解更要多動手首先使用QuartusII編譯簡單的程序并進行調試仿真。然后學會接線并使用CPLD芯片運行小的電路。最后將自己編譯的出租車計費程序進行調試程序部分分為五個模塊，調試的過程中出現了一些錯誤由于自己對軟件的使用不是很熟悉因此找錯誤用了很長的時間，但最后的努力沒有浪費，排除錯誤之后調試成功基本上能夠實現所要求的功能讓我感到極大的欣慰。此次課程設計中得到了老師和同學的大量幫助令我能夠順利的完成，幾個同學一起合作即使有困難也能很快解決。讓我體會到團隊合作才會有更大的力量，所以在此衷心的所有幫助我的老師和同學。第6章參考文獻1. EDA技術實用教程—VHDL版潘松，黃繼業編著2. 數字電子技術基礎閻石主編3. VHDL數字電路設計與應用實踐教程王振紅主編4. 圖說VHDL數字電路設計王振紅主編5. VHDL實用教程潘松王國棟編著6．24

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