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2026-06-13 15:41本頁面

　　

【正文】。控制標志位CPSR的最低8位為控制位，它們分別是：中斷標志位I和F 處理器狀態位T 處理器模式位M0~M41，中斷禁止標志位當控制位I位置時，IRQ中斷被禁止，否則允許IRQ中斷使能；當控制位F位置時，FIQ中斷被禁止，否則允許FIQ中斷使能。注意：當I或者F控制位為0時，則允許IRQ或者FIQ中斷（使能），即CPU內核可以響應中斷了。2，控制位T控制位T反映了正在操作的狀態：當控制位T置位時（“1”），處理器正在Thumb狀態下運行；當控制位T清零時（“0”）,處理器正在ARM狀態下運行。警告：絕對不要強制改變CPSR寄存器中的控制位T。如果這樣做，處理器會進入一個無法預知的狀態。 3模式控制位 MMMM1和M0位（即M[4:0]）都是模式控制位不是所有模式位的組合都定義了有效的處理器模式，因此不要使用表中沒有列出的組合 CPSR模式位值M[4:0]模式可見的Tunb狀態寄存器可見的ARM狀態寄存器10000用戶R0~RSP、LR、PC、CPSRR0~R1PC、CPSR10001快速中斷R0~RSP_fiq、LR_fiq、PC、CPSRR0~RR8_fi~R14_fiq、PC、CPSR、SPSR_fiq10010中斷R0~RSP_irq、LR_irq、PC、CPSRR0~R1R13_irq、R14_irq、PC、CPSR、SPSR_irq 保留位 CPSR中的保留位被保留，以便將來使用。請確保程序不依賴于包含特定值的保留位，因為將來的處理器可能會講這些位設置為1或者0.、中斷及其向量表只要正常的程序被暫時中止，處理器就進入異常模式。異常入口/出口總匯異常向量表異常優先級異常中斷的進入與退出1進入異常當一個異常導致模式切換時，內核自動地做如下處理：將異常處理程序的范圍地址保存到相應異常模式下的LR，異常處理程序完成后的返回可通過將LR的值減去偏移量后寫入PC(存斷點) 將CPSR的當前值保存到相應的異常模式下地SPSR,異常處理程序完成后的返回可通過保存在SPSR中的值來恢復CPSR（保存原狀態）設置CPSR為相應的異常模式（設置模式）設置PC為相應異常處理程序的中斷入口向量地址，跳轉到相應的異常中斷處理程序執行（切換狀態）2退出異常當異常處理程序結束時，異常處理程序必須執行如下操作：返回到發生異常中斷的指令的嚇一跳指令處執行將SPSR的值復制回CPSR在入口處置位的中斷禁止控制位清零。復位異常nRESET(n一般低電平有效)信號被拉低時，ARM處理器放棄正在執行的指令當nRESET信號再次變為高電平時，ARM處理器執行以下操作：強制M[4:0]變為b10011,系統進入管理模式將CPSR中的控制位I和F置位，IRQ和FIQ中斷禁止將CPSR中的控制位T清零，處理器處于ARM狀態強制PC從地址0x00開始對嚇一跳指令進行取指返回到ARM狀態并恢復執行中斷請求異常IRQ只有當CPSR中相應的中斷屏蔽被清除時，才可能發生中斷請求（IRQ）異常當異常發生時，程序計數器PC總是指向返回位置的嚇一跳指令即第三條指令，也就是說異常處理程序的正確返回地址為PC4，且在PC8的地址處發生異常中斷程序跳轉。中斷延遲通過軟件處理程序來縮短中斷延遲的方法有2種，它們分別是中斷嵌套和使用高優先級 ARM體系的存儲系統ARM處理器采用馮諾依曼結構，指令和數據公用一條32位數據總線，只有裝載、保存、和交換指令可訪問存儲器中的數據。ARM結構使用232個8位字節地址空間，字節地址的排列從0~2321.230個32位字，將地址除以4，地址為A的包含4個字節，地址分別為A、A+A+2和A+3包含231個16位半字，地址為A的半字包含2個字節，地址分別為A和A+1 存儲器格式 1小端存儲器系統 2大端存儲器系統ARM指令集不包含任何直接懸著大小端存儲器格式的指令，但是一個同時支持大小端存儲器格式基于ARM的芯片可以通過硬件配置（一般使用芯片的引腳來配置）來匹配存儲器系統所使用的規則注意：LPC2000系列ARM制定為小端模式，無論采取任何措施都不可改變15 / 15

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