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數(shù)字電子技術(shù)基礎(chǔ)習(xí)題答案(存儲版)

2025-09-05 01:41上一頁面

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【正文】 8．D 9．C 10．CD11．C 12．D 13．AB 14．A 15．AB 填空題1．低2．修改邏輯設(shè)計接入濾波電容加選通脈沖習(xí)題當(dāng)A、B、C三個變量不一致時，電路輸出為“1”，所以這個電路，稱為“不一致電路”。：取。 (1) 得到74151各個數(shù)據(jù)輸入端的值為：D0=0，D1=ABC=，D2=A+B+C=，D3==，D4==, D5==，D6= AB+AC+BC=，D7=1。（1）計數(shù)器最高位觸發(fā)器的輸出脈沖頻率為（2）需要用10個觸發(fā)器構(gòu)成。邏輯圖略。（1）狀態(tài)轉(zhuǎn)換如圖P511（a）所示：圖P511（a）（2）選下降沿觸發(fā)的JK觸發(fā)器。圖P517(b) CT74160為帶同步預(yù)置端的十進制加法計數(shù)器，由圖可知，當(dāng)CO=1時，；而T1147為二—十進制優(yōu)先權(quán)編碼器，當(dāng)時，同時其余輸入端為1時，此時CT160為九進制計數(shù)器，其狀態(tài)轉(zhuǎn)換圖如圖P518所示. 圖P518Z的頻率fz是CP頻率fcp的1/9。狀態(tài)轉(zhuǎn)換圖如圖P525a所示。從到輸出由表P528可知，此電路每隔八個CP脈沖循環(huán)一次，所以應(yīng)設(shè)計一個八進制計數(shù)器。（1）（ 2 ）增大 R 3（ 3 ）電路中電容 C2 起濾波作用，電容 C3 起隔直、通交流的作用。可編程邏輯器件是可由用戶編程、配置的一類邏輯器件的泛稱。解：PAL采用雙極型工藝制作，熔絲編程方式，工作速度較高。解：① 結(jié)構(gòu)差異。CPLD的編程采用E2PROM或Flash技術(shù)，無需外部存儲器芯片，使用簡單；而FPGA的編程信息需存放在外部存儲器上，使用方法復(fù)雜，且FPGA的編程數(shù)據(jù)存放在EPROM中，讀出并送到FPGA的SRAM中，不利于保密。解：解：在結(jié)構(gòu)上，它包括宏單元(Macrocell)、邏輯陣列塊(LAB, Logic Array Block)、擴展乘積項(EPT, Expender Product Term)、可編程連線陣列(PIA, Programmable Interconnect Array)和I/O控制塊(I/O Control Block)等幾部分。邏輯功能通過配置時，編程EAB為只讀模型，生成一個大的查找表LUT來實現(xiàn)。：，輸出波形略。：(1)應(yīng)選擇10位的A/D轉(zhuǎn)換器24。：。EAB是一種輸入、輸出端帶有寄存器的非常靈活的RAM，它既可以作為存儲器使用，也可以用來實現(xiàn)邏輯功能。習(xí) 題解：可編程邏輯器件的發(fā)展經(jīng)歷了以下過程：PROM→PLA→PAL→GAL→CPLD→FPGA。換句話說，F(xiàn)PGA更適合于觸發(fā)器豐富的結(jié)構(gòu)，而CPLD更適合于觸發(fā)器有限而乘積項豐富的結(jié)構(gòu)。解：GAL采用了電擦除可編程的E2CMOS工藝制作，有電擦寫反復(fù)編程的特性。另外，在有些型號的PAL器件中，輸出電路中設(shè)置有觸發(fā)器和從觸發(fā)器輸出到與邏輯陣列的反饋線，利用這種PAL器件還可以很方便地構(gòu)成各種時序邏輯電路。正常工作時，光電管導(dǎo)通，施密特觸發(fā)器輸入為高電平，OUT=“0”。526 X=0時為五進制計數(shù)器，X=1時為六進制計數(shù)器。（2） T4194構(gòu)成扭環(huán)形計數(shù)器時，從、、取反饋分別構(gòu)成8分頻（即M=2n）。圖P516 方案一：電路如圖T517(a)所示。（3）改圈的卡諾圖即可使電路由不能自啟動變?yōu)樽詥樱目ㄖZ圖如圖T510（e）。，，，能夠自啟動。此電路為能自啟動的異步五進制計數(shù)器。當(dāng)相加的結(jié)果大于1001時，數(shù)碼管不顯示。 Y2=0 （a）邏輯功能：完成異或運算的邏輯功能。數(shù)字電子技術(shù)基礎(chǔ)答案第1章自測題1. 2. 4 3. 4. 邏輯代數(shù) 卡諾圖5. 6.7. 代數(shù)法卡諾圖 8. 11. √ 2.√ 3.

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