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計(jì)算機(jī)組成原理第八章輸入輸出系統(tǒng)三課件(編輯修改稿)

2025-10-22 20:06 本頁(yè)面

　

【文章內(nèi)容簡(jiǎn)介】 DMA傳送做準(zhǔn)備 —— （中斷初始化及）對(duì) DMAC的初始化：（ 1）設(shè)備地址 →DAR （設(shè)備地址寄存器）（ 2）內(nèi)存中 DMA緩沖區(qū)首地址 → 內(nèi)存地址計(jì)數(shù)器（ 3）傳送數(shù)據(jù)的字?jǐn)?shù) → 字計(jì)數(shù)器（ 4）啟動(dòng)設(shè)備 DMA數(shù)據(jù)傳送 ? DMA控制器代替 CPU管理 I/O設(shè)備進(jìn)行數(shù)據(jù)傳送：（以輸入過(guò)程為例）（ 1）輸入設(shè)備送一個(gè)字到 DMA控制器的數(shù)據(jù)緩沖寄存器，同時(shí)設(shè)備控制器以 READY信號(hào)置 DMA控制器中 DMA請(qǐng)求觸發(fā)器為 1；（ 2） CPU響應(yīng) DMA請(qǐng)求并在 CPU當(dāng)前存儲(chǔ)周期結(jié)束后，由 DMA占用下一個(gè)存儲(chǔ)周期（ —— 叫做 DMA周期）進(jìn)行寫(xiě)操作： 1）（內(nèi)存地址計(jì)數(shù)器） →MAR ； 2）（接口數(shù)據(jù)緩沖寄存器） →MDR ； 3）發(fā)出 “ 寫(xiě)內(nèi)存 ”命令； ?（ 3）在 DMA控制狀態(tài)邏輯的控制下執(zhí)行三個(gè)操作：存儲(chǔ) 周期存儲(chǔ)器時(shí)序 DMA請(qǐng)求 CPU DMA 周期熱啟動(dòng) 1）（字計(jì)數(shù)器） +1→ 字計(jì)數(shù)器； 2）清 DMA請(qǐng)求標(biāo)志觸發(fā)器； 3）（內(nèi)存地址計(jì)數(shù)器） +1→ 內(nèi)存地址計(jì)數(shù)器，未傳完轉(zhuǎn) 2（ 1）（發(fā)生總線使用權(quán)轉(zhuǎn)讓），否則接下。（ 4）傳送結(jié)束由 DMA控制器中的中斷機(jī)構(gòu)發(fā) DMA中斷請(qǐng)求。 DMA結(jié)束處理 CPU響應(yīng) DMA的中斷請(qǐng)求后，停止原運(yùn)行程序轉(zhuǎn)去執(zhí)行 DMA中斷服務(wù)程序以完成 DMA結(jié)束處理工作。 —— 因此 DMA接口應(yīng)保留中斷功能。 —— 由該過(guò)程體會(huì)周期挪用方式每傳一個(gè)字的 “ 附加操作 ” 及透明 DMA的優(yōu)點(diǎn)。有關(guān)的書(shū)后習(xí)題 —— ~ 第 4題、采用 DMA方式傳送數(shù)據(jù)時(shí)，每傳送一個(gè)數(shù)據(jù)就要占用一個(gè)（）的時(shí)間。 A. 指令周期 B. 機(jī)器周期 C. 存儲(chǔ)周期 D. 總線周期第 12題、下列陳述中正確的是 ( )。 A. 在 DMA周期內(nèi)， CPU不能執(zhí)行程序 B. 中斷發(fā)生時(shí)， CPU首先執(zhí)行入棧指令將程序計(jì)數(shù)器內(nèi)容保護(hù)起來(lái) C. DMA傳送方式中， DMA控制器每傳送一個(gè)數(shù)據(jù)就竊取一個(gè)指令周期 D. 輸入輸出操作的最終目的是要實(shí)現(xiàn) CPU與外設(shè)之間的信息傳輸。 ? 第 16題：比較通道、 DMA、中斷三種基本 I/O方式的

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